project.elf: file format elf32-avr Disassembly of section .text: 00000000 <__vectors>: 0: 9e c0 rjmp .+316 ; 0x13e <__ctors_end> 2: 67 c5 rjmp .+2766 ; 0xad2 <__bad_interrupt> 4: f5 c4 rjmp .+2538 ; 0x9f0 <__vector_2> 6: 65 c5 rjmp .+2762 ; 0xad2 <__bad_interrupt> 8: 64 c5 rjmp .+2760 ; 0xad2 <__bad_interrupt> a: 63 c5 rjmp .+2758 ; 0xad2 <__bad_interrupt> c: 62 c5 rjmp .+2756 ; 0xad2 <__bad_interrupt> e: 61 c5 rjmp .+2754 ; 0xad2 <__bad_interrupt> 10: 60 c5 rjmp .+2752 ; 0xad2 <__bad_interrupt> 12: 5f c5 rjmp .+2750 ; 0xad2 <__bad_interrupt> 14: 5e c5 rjmp .+2748 ; 0xad2 <__bad_interrupt> 16: 5d c5 rjmp .+2746 ; 0xad2 <__bad_interrupt> 18: 5c c5 rjmp .+2744 ; 0xad2 <__bad_interrupt> 1a: 5b c5 rjmp .+2742 ; 0xad2 <__bad_interrupt> 1c: 5a c5 rjmp .+2740 ; 0xad2 <__bad_interrupt> 1e: 59 c5 rjmp .+2738 ; 0xad2 <__bad_interrupt> 20: 58 c5 rjmp .+2736 ; 0xad2 <__bad_interrupt> 22: 57 c5 rjmp .+2734 ; 0xad2 <__bad_interrupt> 24: 56 c5 rjmp .+2732 ; 0xad2 <__bad_interrupt> 26: 55 c5 rjmp .+2730 ; 0xad2 <__bad_interrupt> 28: 54 c5 rjmp .+2728 ; 0xad2 <__bad_interrupt> 2a: 53 c5 rjmp .+2726 ; 0xad2 <__bad_interrupt> 2c: 52 c5 rjmp .+2724 ; 0xad2 <__bad_interrupt> 2e: 51 c5 rjmp .+2722 ; 0xad2 <__bad_interrupt> 30: 50 c5 rjmp .+2720 ; 0xad2 <__bad_interrupt> 32: 4f c5 rjmp .+2718 ; 0xad2 <__bad_interrupt> 34: 4e c5 rjmp .+2716 ; 0xad2 <__bad_interrupt> 36: 4d c5 rjmp .+2714 ; 0xad2 <__bad_interrupt> 38: 4c c5 rjmp .+2712 ; 0xad2 <__bad_interrupt> 3a: 4b c5 rjmp .+2710 ; 0xad2 <__bad_interrupt> 3c: 4a c5 rjmp .+2708 ; 0xad2 <__bad_interrupt> 0000003e <.dinit>: 3e: 3e 00 .word 0x003e ; ???? 40: 3e 03 fmul r19, r22 42: 80 00 .word 0x0080 ; ???? 00000044 <__trampolines_end>: 44: 00 40 sbci r16, 0x00 ; 0 46: 7a 10 cpse r7, r10 48: f3 5a subi r31, 0xA3 ; 163 4a: 00 a0 ldd r0, Z+32 ; 0x20 4c: 72 4e sbci r23, 0xE2 ; 226 4e: 18 09 sbc r17, r8 50: 00 10 cpse r0, r0 52: a5 d4 rcall .+2378 ; 0x99e <__epilogue_restores__+0x24> 54: e8 00 .word 0x00e8 ; ???? 56: 00 e8 ldi r16, 0x80 ; 128 58: 76 48 sbci r23, 0x86 ; 134 5a: 17 00 .word 0x0017 ; ???? 5c: 00 e4 ldi r16, 0x40 ; 64 5e: 0b 54 subi r16, 0x4B ; 75 60: 02 00 .word 0x0002 ; ???? 62: 00 ca rjmp .-3072 ; 0xfffff464 <__fuse+0xff7df464> 64: 9a 3b cpi r25, 0xBA ; 186 66: 00 00 nop 68: 00 e1 ldi r16, 0x10 ; 16 6a: f5 05 cpc r31, r5 6c: 00 00 nop 6e: 80 96 adiw r24, 0x20 ; 32 70: 98 00 .word 0x0098 ; ???? 72: 00 00 nop 74: 40 42 sbci r20, 0x20 ; 32 76: 0f 00 .word 0x000f ; ???? 78: 00 00 nop 7a: a0 86 std Z+8, r10 ; 0x08 7c: 01 00 .word 0x0001 ; ???? 7e: 00 00 nop 80: 10 27 eor r17, r16 82: 00 00 nop 84: 00 00 nop 86: e8 03 fmulsu r22, r16 88: 00 00 nop 8a: 00 00 nop 8c: 64 00 .word 0x0064 ; ???? 8e: 00 00 nop 90: 00 00 nop 92: 0a 00 .word 0x000a ; ???? 94: 00 00 nop 96: 00 00 nop 98: 01 00 .word 0x0001 ; ???? 9a: 00 00 nop 9c: 00 00 nop 9e: 2c 76 andi r18, 0x6C ; 108 a0: d8 88 ldd r13, Y+16 ; 0x10 a2: dc 67 ori r29, 0x7C ; 124 a4: 4f 08 sbc r4, r15 a6: 23 df rcall .-442 ; 0xfffffeee <__fuse+0xff7dfeee> a8: c1 df rcall .-126 ; 0x2c <__FUSE_REGION_LENGTH__+0x22> aa: ae 59 subi r26, 0x9E ; 158 ac: e1 b1 in r30, 0x01 ; 1 ae: b7 96 adiw r30, 0x27 ; 39 b0: e5 e3 ldi r30, 0x35 ; 53 b2: e4 53 subi r30, 0x34 ; 52 b4: c6 3a cpi r28, 0xA6 ; 166 b6: e6 51 subi r30, 0x16 ; 22 b8: 99 76 andi r25, 0x69 ; 105 ba: 96 e8 ldi r25, 0x86 ; 134 bc: e6 c2 rjmp .+1484 ; 0x68a <__divsf3_pse+0x6a> be: 84 26 eor r8, r20 c0: eb 89 ldd r30, Y+19 ; 0x13 c2: 8c 9b sbis 0x11, 4 ; 17 c4: 62 ed ldi r22, 0xD2 ; 210 c6: 40 7c andi r20, 0xC0 ; 192 c8: 6f fc .word 0xfc6f ; ???? ca: ef bc out 0x2f, r14 ; 47 cc: 9c 9f mul r25, r28 ce: 40 f2 brcs .-112 ; 0x60 <__trampolines_end+0x1c> d0: ba a5 ldd r27, Y+42 ; 0x2a d2: 6f a5 ldd r22, Y+47 ; 0x2f d4: f4 90 lpm r15, Z d6: 05 5a subi r16, 0xA5 ; 165 d8: 2a f7 brpl .-54 ; 0xa4 <__EEPROM_REGION_LENGTH__+0x24> da: 5c 93 st X, r21 dc: 6b 6c ori r22, 0xCB ; 203 de: f9 67 ori r31, 0x79 ; 121 e0: 6d c1 rjmp .+730 ; 0x3bc <__DATA_REGION_LENGTH__+0x1bc> e2: 1b fc .word 0xfc1b ; ???? e4: e0 e4 ldi r30, 0x40 ; 64 e6: 0d 47 sbci r16, 0x7D ; 125 e8: fe f5 brtc .+126 ; 0x168 <__do_copy_data+0x1e> ea: 20 e6 ldi r18, 0x60 ; 96 ec: b5 00 .word 0x00b5 ; ???? ee: d0 ed ldi r29, 0xD0 ; 208 f0: 90 2e mov r9, r16 f2: 03 00 .word 0x0003 ; ???? f4: 94 35 cpi r25, 0x54 ; 84 f6: 77 05 cpc r23, r7 f8: 00 80 ld r0, Z fa: 84 1e adc r8, r20 fc: 08 00 .word 0x0008 ; ???? fe: 00 20 and r0, r0 100: 4e 0a sbc r4, r30 102: 00 00 nop 104: 00 c8 rjmp .-4096 ; 0xfffff106 <__fuse+0xff7df106> 106: 0c 33 cpi r16, 0x3C ; 60 108: 33 33 cpi r19, 0x33 ; 51 10a: 33 0f add r19, r19 10c: 98 6e ori r25, 0xE8 ; 232 10e: 12 83 std Z+2, r17 ; 0x02 110: 11 41 sbci r17, 0x11 ; 17 112: ef 8d ldd r30, Y+31 ; 0x1f 114: 21 14 cp r2, r1 116: 89 3b cpi r24, 0xB9 ; 185 118: e6 55 subi r30, 0x56 ; 86 11a: 16 cf rjmp .-468 ; 0xffffff48 <__fuse+0xff7dff48> 11c: fe e6 ldi r31, 0x6E ; 110 11e: db 18 sub r13, r11 120: d1 84 ldd r13, Z+9 ; 0x09 122: 4b 38 cpi r20, 0x8B ; 139 124: 1b f7 brvc .-58 ; 0xec <__EEPROM_REGION_LENGTH__+0x6c> 126: 7c 1d adc r23, r12 128: 90 1d adc r25, r0 12a: a4 bb out 0x14, r26 ; 20 12c: e4 24 eor r14, r4 12e: 20 32 cpi r18, 0x20 ; 32 130: 84 72 andi r24, 0x24 ; 36 132: 5e 22 and r5, r30 134: 81 00 .word 0x0081 ; ???? 136: c9 f1 breq .+114 ; 0x1aa 138: 24 ec ldi r18, 0xC4 ; 196 13a: a1 e5 ldi r26, 0x51 ; 81 13c: 3d 27 eor r19, r29 0000013e <__ctors_end>: 13e: 11 24 eor r1, r1 140: 1f be out 0x3f, r1 ; 63 142: cf ef ldi r28, 0xFF ; 255 144: cd bf out 0x3d, r28 ; 61 146: df e3 ldi r29, 0x3F ; 63 148: de bf out 0x3e, r29 ; 62 0000014a <__do_copy_data>: 14a: ee e3 ldi r30, 0x3E ; 62 14c: f0 e0 ldi r31, 0x00 ; 0 14e: 40 e0 ldi r20, 0x00 ; 0 150: 17 c0 rjmp .+46 ; 0x180 <__do_clear_bss+0x8> 152: b5 91 lpm r27, Z+ 154: a5 91 lpm r26, Z+ 156: 35 91 lpm r19, Z+ 158: 25 91 lpm r18, Z+ 15a: 05 91 lpm r16, Z+ 15c: 07 fd sbrc r16, 7 15e: 0c c0 rjmp .+24 ; 0x178 <__do_clear_bss> 160: 95 91 lpm r25, Z+ 162: 85 91 lpm r24, Z+ 164: ef 01 movw r28, r30 166: f9 2f mov r31, r25 168: e8 2f mov r30, r24 16a: 05 90 lpm r0, Z+ 16c: 0d 92 st X+, r0 16e: a2 17 cp r26, r18 170: b3 07 cpc r27, r19 172: d9 f7 brne .-10 ; 0x16a <__do_copy_data+0x20> 174: fe 01 movw r30, r28 176: 04 c0 rjmp .+8 ; 0x180 <__do_clear_bss+0x8> 00000178 <__do_clear_bss>: 178: 1d 92 st X+, r1 17a: a2 17 cp r26, r18 17c: b3 07 cpc r27, r19 17e: e1 f7 brne .-8 ; 0x178 <__do_clear_bss> 180: e3 34 cpi r30, 0x43 ; 67 182: f4 07 cpc r31, r20 184: 31 f7 brne .-52 ; 0x152 <__do_copy_data+0x8> 186: 10 d3 rcall .+1568 ; 0x7a8
188: 00 c0 rjmp .+0 ; 0x18a <_exit> 0000018a <_exit>: 18a: f8 94 cli 0000018c <__stop_program>: 18c: ff cf rjmp .-2 ; 0x18c <__stop_program> Disassembly of section .text: 00000ad2 <__bad_interrupt>: ad2: 96 ca rjmp .-2772 ; 0x0 <__TEXT_REGION_ORIGIN__> Disassembly of section .text.init_adc: 00000a38 : 5 /* read ADC CHANNEL 5 : pin PA5 */ void init_adc() { ADC0.CTRLC = ADC_PRESC_DIV4_gc /* CLK_PER divided by 4 */ a38: e0 e0 ldi r30, 0x00 ; 0 a3a: f6 e0 ldi r31, 0x06 ; 6 a3c: 81 e0 ldi r24, 0x01 ; 1 a3e: 82 83 std Z+2, r24 ; 0x02 | ADC_REFSEL_INTREF_gc /* Internal reference */ | 0 << ADC_SAMPCAP_bp; /* Sample Capacitance Selection: disabled */ ADC0.MUXPOS = ADC_MUXPOS_AIN5_gc; /* ADC input pin 5 */ a40: 95 e0 ldi r25, 0x05 ; 5 a42: 96 83 std Z+6, r25 ; 0x06 ADC0.CTRLA = 1 << ADC_ENABLE_bp /* ADC Enable: enabled */ a44: 80 83 st Z, r24 a46: 08 95 ret Disassembly of section .text.init_usart: 00000a26 : #define USART0_BAUD_RATE(BAUD_RATE) ((float)(3333333 * 64 / (16 * (float)BAUD_RATE)) + 0.5) void init_usart() { USART0.BAUD = (uint16_t)USART0_BAUD_RATE(9600); /* set baud rate register */ a26: e0 e0 ldi r30, 0x00 ; 0 a28: f8 e0 ldi r31, 0x08 ; 8 a2a: 8d e6 ldi r24, 0x6D ; 109 a2c: 95 e0 ldi r25, 0x05 ; 5 a2e: 80 87 std Z+8, r24 ; 0x08 a30: 91 87 std Z+9, r25 ; 0x09 USART0.CTRLB = 0 << USART_MPCM_bp /* Multi-processor Communication Mode: disabled */ a32: 80 e4 ldi r24, 0x40 ; 64 a34: 86 83 std Z+6, r24 ; 0x06 a36: 08 95 ret Disassembly of section .text.init_vref: 00000a48 : | 1 << USART_TXEN_bp; /* Transmitter Enable: enabled */ } void init_vref() { VREF_CTRLA = VREF_ADC0REFSEL_2V5_gc /* Voltage reference at 2.5V */ a48: 80 e2 ldi r24, 0x20 ; 32 a4a: 80 93 a0 00 sts 0x00A0, r24 ; 0x8000a0 <__RODATA_PM_OFFSET__+0x7f80a0> | VREF_DAC0REFSEL_0V55_gc; /* Voltage reference at 0.55V */ VREF_CTRLB = 1 << VREF_ADC0REFEN_bp /* ADC0 reference enable: enabled */ a4e: 82 e0 ldi r24, 0x02 ; 2 a50: 80 93 a1 00 sts 0x00A1, r24 ; 0x8000a1 <__RODATA_PM_OFFSET__+0x7f80a1> a54: 08 95 ret Disassembly of section .text.init_tca: 00000a56 : | 0 << VREF_DAC0REFEN_bp; /* DAC0/AC0 reference enable: disabled */ } void init_tca() { TCA0.SINGLE.CTRLB = 0 << TCA_SINGLE_ALUPD_bp /* Auto Lock Update: disabled */ a56: e0 e0 ldi r30, 0x00 ; 0 a58: fa e0 ldi r31, 0x0A ; 10 a5a: 83 e1 ldi r24, 0x13 ; 19 a5c: 81 83 std Z+1, r24 ; 0x01 | 1 << TCA_SINGLE_CMP0EN_bp /* Setting: enabled */ | 0 << TCA_SINGLE_CMP1EN_bp /* Setting: disabled */ | 0 << TCA_SINGLE_CMP2EN_bp /* Setting: disabled */ | TCA_SINGLE_WGMODE_SINGLESLOPE_gc; /* */ TCA0.SINGLE.CTRLA = TCA_SINGLE_CLKSEL_DIV1_gc /* System Clock */ a5e: 81 e0 ldi r24, 0x01 ; 1 a60: 80 83 st Z, r24 a62: 08 95 ret Disassembly of section .text.USART_0_write: 00000a64 : | 1 << TCA_SINGLE_ENABLE_bp; /* Module Enable: enabled */ } void USART_0_write(uint8_t dt) { while ((USART0.STATUS & USART_DREIF_bm) == 0); a64: 90 91 04 08 lds r25, 0x0804 ; 0x800804 <__RODATA_PM_OFFSET__+0x7f8804> a68: 95 ff sbrs r25, 5 a6a: fc cf rjmp .-8 ; 0xa64 USART0.TXDATAL = dt; a6c: 80 93 02 08 sts 0x0802, r24 ; 0x800802 <__RODATA_PM_OFFSET__+0x7f8802> a70: 08 95 ret Disassembly of section .text.sendString: 00000a0e : } void sendString(char *s) { a0e: cf 93 push r28 a10: df 93 push r29 a12: ec 01 movw r28, r24 while (*s != 0) a14: 02 c0 rjmp .+4 ; 0xa1a { USART_0_write(*s); a16: 26 d0 rcall .+76 ; 0xa64 s++; a18: 21 96 adiw r28, 0x01 ; 1 USART0.TXDATAL = dt; } void sendString(char *s) { while (*s != 0) a1a: 88 81 ld r24, Y a1c: 81 11 cpse r24, r1 a1e: fb cf rjmp .-10 ; 0xa16 { USART_0_write(*s); s++; } } a20: df 91 pop r29 a22: cf 91 pop r28 a24: 08 95 ret Disassembly of section .text.ADC_0_get_conversion: 000009aa : uint16_t ADC_0_get_conversion(int channel) { // Start conversion ADC0.MUXPOS = channel; 9aa: e0 e0 ldi r30, 0x00 ; 0 9ac: f6 e0 ldi r31, 0x06 ; 6 9ae: 86 83 std Z+6, r24 ; 0x06 ADC0.COMMAND = ADC_STCONV_bm; 9b0: 81 e0 ldi r24, 0x01 ; 1 9b2: 80 87 std Z+8, r24 ; 0x08 while ((ADC0.INTFLAGS & ADC_RESRDY_bm) == 0); 9b4: 80 91 0b 06 lds r24, 0x060B ; 0x80060b <__RODATA_PM_OFFSET__+0x7f860b> 9b8: 80 ff sbrs r24, 0 9ba: fc cf rjmp .-8 ; 0x9b4 uint16_t res = ADC0.RES; 9bc: e0 e0 ldi r30, 0x00 ; 0 9be: f6 e0 ldi r31, 0x06 ; 6 9c0: 20 89 ldd r18, Z+16 ; 0x10 9c2: 31 89 ldd r19, Z+17 ; 0x11 ADC0.INTFLAGS |= ADC_RESRDY_bm; 9c4: 93 85 ldd r25, Z+11 ; 0x0b 9c6: 91 60 ori r25, 0x01 ; 1 9c8: 93 87 std Z+11, r25 ; 0x0b return res; } 9ca: c9 01 movw r24, r18 9cc: 08 95 ret Disassembly of section .text.PWM_TCA_load_duty_cycle_ch0: 00000aa8 : void PWM_TCA_load_duty_cycle_ch0(uint16_t duty_value) { TCA0.SINGLE.CMP0BUF = duty_value; aa8: 80 93 38 0a sts 0x0A38, r24 ; 0x800a38 <__RODATA_PM_OFFSET__+0x7f8a38> aac: 90 93 39 0a sts 0x0A39, r25 ; 0x800a39 <__RODATA_PM_OFFSET__+0x7f8a39> ab0: 08 95 ret Disassembly of section .text.PWM_TCA_load_top: 00000ab2 : } void PWM_TCA_load_top(uint16_t top_value) { TCA0.SINGLE.PERBUF = top_value; ab2: 80 93 36 0a sts 0x0A36, r24 ; 0x800a36 <__RODATA_PM_OFFSET__+0x7f8a36> ab6: 90 93 37 0a sts 0x0A37, r25 ; 0x800a37 <__RODATA_PM_OFFSET__+0x7f8a37> aba: 08 95 ret Disassembly of section .text.main: 000007a8
: USART_0_write((uint8_t)(adc_result >> 8)); /* ADC sample MSB */ USART_0_write(0xFC); /* Data Streamer protocol END */ } int main(void) { 7a8: cf 93 push r28 7aa: df 93 push r29 7ac: cd b7 in r28, 0x3d ; 61 7ae: de b7 in r29, 0x3e ; 62 7b0: e2 97 sbiw r28, 0x32 ; 50 7b2: cd bf out 0x3d, r28 ; 61 7b4: de bf out 0x3e, r29 ; 62 // Initialize pins PORTA.DIR = 0x00; // PA5(ADC0ch5)-in 7b6: 10 92 00 04 sts 0x0400, r1 ; 0x800400 <__RODATA_PM_OFFSET__+0x7f8400> PORTB.OUT = 0xFF; 7ba: e0 e2 ldi r30, 0x20 ; 32 7bc: f4 e0 ldi r31, 0x04 ; 4 7be: 8f ef ldi r24, 0xFF ; 255 7c0: 84 83 std Z+4, r24 ; 0x04 PORTB.DIR = (1<<2)|(1<<0); // PB2(USART0TX)-out, PB0(TCA0CH0)-out 7c2: 85 e0 ldi r24, 0x05 ; 5 7c4: 80 83 st Z, r24 init_adc(); 7c6: 38 d1 rcall .+624 ; 0xa38 init_usart(); 7c8: 2e d1 rcall .+604 ; 0xa26 init_vref(); 7ca: 3e d1 rcall .+636 ; 0xa48 /* Harmonic noise is enabled so generate PWM using TCA at pin PB0*/ #if HARMONIC_NOISE init_tca(); 7cc: 44 d1 rcall .+648 ; 0xa56 PWM_TCA_load_top((F_CPU / PWM_FRQ) - 1); 7ce: 81 e4 ldi r24, 0x41 ; 65 7d0: 91 e0 ldi r25, 0x01 ; 1 7d2: 6f d1 rcall .+734 ; 0xab2 PWM_TCA_load_duty_cycle_ch0(((F_CPU / PWM_FRQ) - 1) / 2); /* 50 % duty cycle */ 7d4: 80 ea ldi r24, 0xA0 ; 160 7d6: 90 e0 ldi r25, 0x00 ; 0 7d8: 67 d1 rcall .+718 ; 0xaa8 #endif ADC0.CTRLD |= SAMPLING_DELAY; 7da: e0 e0 ldi r30, 0x00 ; 0 7dc: f6 e0 ldi r31, 0x06 ; 6 7de: 83 81 ldd r24, Z+3 ; 0x03 7e0: 83 83 std Z+3, r24 ; 0x03 #if ENABLE_ASDV ADC0.CTRLD |= 1 << ADC_ASDV_bp; 7e2: 83 81 ldd r24, Z+3 ; 0x03 7e4: 80 61 ori r24, 0x10 ; 16 7e6: 83 83 std Z+3, r24 ; 0x03 #endif #if ADC_64X_ACCUMULATOR_ENABLE ADC0.CTRLB = ADC_SAMPNUM_ACC64_gc; 7e8: 86 e0 ldi r24, 0x06 ; 6 7ea: 81 83 std Z+1, r24 ; 0x01 result_shift_cnt = 6; 7ec: 80 93 00 3e sts 0x3E00, r24 ; 0x803e00 <__DATA_REGION_ORIGIN__> char string[50]; float avg; while (1) { adc_result = ADC_0_get_conversion(ADC_CHANNEL); 7f0: 85 e0 ldi r24, 0x05 ; 5 7f2: 90 e0 ldi r25, 0x00 ; 0 7f4: da d0 rcall .+436 ; 0x9aa adc_result >>= result_shift_cnt; 7f6: 00 90 00 3e lds r0, 0x3E00 ; 0x803e00 <__DATA_REGION_ORIGIN__> 7fa: 02 c0 rjmp .+4 ; 0x800 7fc: 96 95 lsr r25 7fe: 87 95 ror r24 800: 0a 94 dec r0 802: e2 f7 brpl .-8 ; 0x7fc 804: 80 93 01 3e sts 0x3E01, r24 ; 0x803e01 808: 90 93 02 3e sts 0x3E02, r25 ; 0x803e02 sendString("Vavg = "); 80c: 8e e8 ldi r24, 0x8E ; 142 80e: 91 e8 ldi r25, 0x81 ; 129 810: fe d0 rcall .+508 ; 0xa0e dtostrf((adc_result * MAX_VOL) / RES_10BIT, 1, 4, string); 812: 60 91 01 3e lds r22, 0x3E01 ; 0x803e01 816: 70 91 02 3e lds r23, 0x3E02 ; 0x803e02 81a: 80 e0 ldi r24, 0x00 ; 0 81c: 90 e0 ldi r25, 0x00 ; 0 81e: 16 d0 rcall .+44 ; 0x84c <__floatunsisf> 820: 20 e0 ldi r18, 0x00 ; 0 822: 30 e0 ldi r19, 0x00 ; 0 824: 40 e2 ldi r20, 0x20 ; 32 826: 50 e4 ldi r21, 0x40 ; 64 828: 4d d1 rcall .+666 ; 0xac4 <__mulsf3> 82a: 20 e0 ldi r18, 0x00 ; 0 82c: 30 ec ldi r19, 0xC0 ; 192 82e: 4f e7 ldi r20, 0x7F ; 127 830: 54 e4 ldi r21, 0x44 ; 68 832: 44 d1 rcall .+648 ; 0xabc <__divsf3> 834: 8e 01 movw r16, r28 836: 0f 5f subi r16, 0xFF ; 255 838: 1f 4f sbci r17, 0xFF ; 255 83a: 24 e0 ldi r18, 0x04 ; 4 83c: 41 e0 ldi r20, 0x01 ; 1 83e: 65 d0 rcall .+202 ; 0x90a sendString(string); 840: c8 01 movw r24, r16 842: e5 d0 rcall .+458 ; 0xa0e sendString(" V\r\n"); 844: 86 e9 ldi r24, 0x96 ; 150 846: 91 e8 ldi r25, 0x81 ; 129 848: e2 d0 rcall .+452 ; 0xa0e 84a: d2 cf rjmp .-92 ; 0x7f0 Disassembly of section .text.__vector_2: 000009f0 <__vector_2>: { return 0; } ISR(BOD_VLM_vect) { 9f0: 1f 92 push r1 9f2: 0f 92 push r0 9f4: 0f b6 in r0, 0x3f ; 63 9f6: 0f 92 push r0 9f8: 11 24 eor r1, r1 9fa: 8f 93 push r24 /* Insert your AC interrupt handling code here */ /* The interrupt flag has to be cleared manually */ BOD.INTFLAGS = BOD_VLMIE_bm; 9fc: 81 e0 ldi r24, 0x01 ; 1 9fe: 80 93 8a 00 sts 0x008A, r24 ; 0x80008a <__RODATA_PM_OFFSET__+0x7f808a> } a02: 8f 91 pop r24 a04: 0f 90 pop r0 a06: 0f be out 0x3f, r0 ; 63 a08: 0f 90 pop r0 a0a: 1f 90 pop r1 a0c: 18 95 reti Disassembly of section .text.avrlibc.fplib: 00000abc <__divsf3>: abc: 0e 94 0d 03 call 0x61a ; 0x61a <__divsf3x> ac0: 0c 94 e7 04 jmp 0x9ce ; 0x9ce <__fp_round> Disassembly of section .text.avrlibc.fplib: 000005fa <__divsf3x-0x20>: 5fa: 0e 94 40 05 call 0xa80 ; 0xa80 <__fp_pscB> 5fe: 58 f0 brcs .+22 ; 0x616 <__ftoa_engine+0x1cc> 600: 0e 94 39 05 call 0xa72 ; 0xa72 <__fp_pscA> 604: 40 f0 brcs .+16 ; 0x616 <__ftoa_engine+0x1cc> 606: 29 f4 brne .+10 ; 0x612 <__ftoa_engine+0x1c8> 608: 5f 3f cpi r21, 0xFF ; 255 60a: 29 f0 breq .+10 ; 0x616 <__ftoa_engine+0x1cc> 60c: 0c 94 4e 05 jmp 0xa9c ; 0xa9c <__fp_inf> 610: 51 11 cpse r21, r1 612: 0c 94 48 05 jmp 0xa90 ; 0xa90 <__fp_szero> 616: 0c 94 66 05 jmp 0xacc ; 0xacc <__fp_nan> 0000061a <__divsf3x>: 61a: 0e 94 63 04 call 0x8c6 ; 0x8c6 <__fp_split3> 61e: 68 f3 brcs .-38 ; 0x5fa <__ftoa_engine+0x1b0> 00000620 <__divsf3_pse>: 620: 99 23 and r25, r25 622: b1 f3 breq .-20 ; 0x610 <__ftoa_engine+0x1c6> 624: 55 23 and r21, r21 626: 91 f3 breq .-28 ; 0x60c <__ftoa_engine+0x1c2> 628: 95 1b sub r25, r21 62a: 55 0b sbc r21, r21 62c: bb 27 eor r27, r27 62e: aa 27 eor r26, r26 630: 62 17 cp r22, r18 632: 73 07 cpc r23, r19 634: 84 07 cpc r24, r20 636: 38 f0 brcs .+14 ; 0x646 <__divsf3_pse+0x26> 638: 9f 5f subi r25, 0xFF ; 255 63a: 5f 4f sbci r21, 0xFF ; 255 63c: 22 0f add r18, r18 63e: 33 1f adc r19, r19 640: 44 1f adc r20, r20 642: aa 1f adc r26, r26 644: a9 f3 breq .-22 ; 0x630 <__divsf3_pse+0x10> 646: 35 d0 rcall .+106 ; 0x6b2 <__divsf3_pse+0x92> 648: 0e 2e mov r0, r30 64a: 3a f0 brmi .+14 ; 0x65a <__divsf3_pse+0x3a> 64c: e0 e8 ldi r30, 0x80 ; 128 64e: 32 d0 rcall .+100 ; 0x6b4 <__divsf3_pse+0x94> 650: 91 50 subi r25, 0x01 ; 1 652: 50 40 sbci r21, 0x00 ; 0 654: e6 95 lsr r30 656: 00 1c adc r0, r0 658: ca f7 brpl .-14 ; 0x64c <__divsf3_pse+0x2c> 65a: 2b d0 rcall .+86 ; 0x6b2 <__divsf3_pse+0x92> 65c: fe 2f mov r31, r30 65e: 29 d0 rcall .+82 ; 0x6b2 <__divsf3_pse+0x92> 660: 66 0f add r22, r22 662: 77 1f adc r23, r23 664: 88 1f adc r24, r24 666: bb 1f adc r27, r27 668: 26 17 cp r18, r22 66a: 37 07 cpc r19, r23 66c: 48 07 cpc r20, r24 66e: ab 07 cpc r26, r27 670: b0 e8 ldi r27, 0x80 ; 128 672: 09 f0 breq .+2 ; 0x676 <__divsf3_pse+0x56> 674: bb 0b sbc r27, r27 676: 80 2d mov r24, r0 678: bf 01 movw r22, r30 67a: ff 27 eor r31, r31 67c: 93 58 subi r25, 0x83 ; 131 67e: 5f 4f sbci r21, 0xFF ; 255 680: 3a f0 brmi .+14 ; 0x690 <__divsf3_pse+0x70> 682: 9e 3f cpi r25, 0xFE ; 254 684: 51 05 cpc r21, r1 686: 78 f0 brcs .+30 ; 0x6a6 <__divsf3_pse+0x86> 688: 0c 94 4e 05 jmp 0xa9c ; 0xa9c <__fp_inf> 68c: 0c 94 48 05 jmp 0xa90 ; 0xa90 <__fp_szero> 690: 5f 3f cpi r21, 0xFF ; 255 692: e4 f3 brlt .-8 ; 0x68c <__divsf3_pse+0x6c> 694: 98 3e cpi r25, 0xE8 ; 232 696: d4 f3 brlt .-12 ; 0x68c <__divsf3_pse+0x6c> 698: 86 95 lsr r24 69a: 77 95 ror r23 69c: 67 95 ror r22 69e: b7 95 ror r27 6a0: f7 95 ror r31 6a2: 9f 5f subi r25, 0xFF ; 255 6a4: c9 f7 brne .-14 ; 0x698 <__divsf3_pse+0x78> 6a6: 88 0f add r24, r24 6a8: 91 1d adc r25, r1 6aa: 96 95 lsr r25 6ac: 87 95 ror r24 6ae: 97 f9 bld r25, 7 6b0: 08 95 ret 6b2: e1 e0 ldi r30, 0x01 ; 1 6b4: 66 0f add r22, r22 6b6: 77 1f adc r23, r23 6b8: 88 1f adc r24, r24 6ba: bb 1f adc r27, r27 6bc: 62 17 cp r22, r18 6be: 73 07 cpc r23, r19 6c0: 84 07 cpc r24, r20 6c2: ba 07 cpc r27, r26 6c4: 20 f0 brcs .+8 ; 0x6ce <__divsf3_pse+0xae> 6c6: 62 1b sub r22, r18 6c8: 73 0b sbc r23, r19 6ca: 84 0b sbc r24, r20 6cc: ba 0b sbc r27, r26 6ce: ee 1f adc r30, r30 6d0: 88 f7 brcc .-30 ; 0x6b4 <__divsf3_pse+0x94> 6d2: e0 95 com r30 6d4: 08 95 ret Disassembly of section .text.avrlibc.fplib: 0000084c <__floatunsisf>: 84c: e8 94 clt 84e: 09 c0 rjmp .+18 ; 0x862 <__floatsisf+0x12> 00000850 <__floatsisf>: 850: 97 fb bst r25, 7 852: 3e f4 brtc .+14 ; 0x862 <__floatsisf+0x12> 854: 90 95 com r25 856: 80 95 com r24 858: 70 95 com r23 85a: 61 95 neg r22 85c: 7f 4f sbci r23, 0xFF ; 255 85e: 8f 4f sbci r24, 0xFF ; 255 860: 9f 4f sbci r25, 0xFF ; 255 862: 99 23 and r25, r25 864: a9 f0 breq .+42 ; 0x890 <__floatsisf+0x40> 866: f9 2f mov r31, r25 868: 96 e9 ldi r25, 0x96 ; 150 86a: bb 27 eor r27, r27 86c: 93 95 inc r25 86e: f6 95 lsr r31 870: 87 95 ror r24 872: 77 95 ror r23 874: 67 95 ror r22 876: b7 95 ror r27 878: f1 11 cpse r31, r1 87a: f8 cf rjmp .-16 ; 0x86c <__floatsisf+0x1c> 87c: fa f4 brpl .+62 ; 0x8bc <__floatsisf+0x6c> 87e: bb 0f add r27, r27 880: 11 f4 brne .+4 ; 0x886 <__floatsisf+0x36> 882: 60 ff sbrs r22, 0 884: 1b c0 rjmp .+54 ; 0x8bc <__floatsisf+0x6c> 886: 6f 5f subi r22, 0xFF ; 255 888: 7f 4f sbci r23, 0xFF ; 255 88a: 8f 4f sbci r24, 0xFF ; 255 88c: 9f 4f sbci r25, 0xFF ; 255 88e: 16 c0 rjmp .+44 ; 0x8bc <__floatsisf+0x6c> 890: 88 23 and r24, r24 892: 11 f0 breq .+4 ; 0x898 <__floatsisf+0x48> 894: 96 e9 ldi r25, 0x96 ; 150 896: 11 c0 rjmp .+34 ; 0x8ba <__floatsisf+0x6a> 898: 77 23 and r23, r23 89a: 21 f0 breq .+8 ; 0x8a4 <__floatsisf+0x54> 89c: 9e e8 ldi r25, 0x8E ; 142 89e: 87 2f mov r24, r23 8a0: 76 2f mov r23, r22 8a2: 05 c0 rjmp .+10 ; 0x8ae <__floatsisf+0x5e> 8a4: 66 23 and r22, r22 8a6: 71 f0 breq .+28 ; 0x8c4 <__floatsisf+0x74> 8a8: 96 e8 ldi r25, 0x86 ; 134 8aa: 86 2f mov r24, r22 8ac: 70 e0 ldi r23, 0x00 ; 0 8ae: 60 e0 ldi r22, 0x00 ; 0 8b0: 2a f0 brmi .+10 ; 0x8bc <__floatsisf+0x6c> 8b2: 9a 95 dec r25 8b4: 66 0f add r22, r22 8b6: 77 1f adc r23, r23 8b8: 88 1f adc r24, r24 8ba: da f7 brpl .-10 ; 0x8b2 <__floatsisf+0x62> 8bc: 88 0f add r24, r24 8be: 96 95 lsr r25 8c0: 87 95 ror r24 8c2: 97 f9 bld r25, 7 8c4: 08 95 ret Disassembly of section .text.avrlibc.fplib: 00000a9c <__fp_inf>: a9c: 97 f9 bld r25, 7 a9e: 9f 67 ori r25, 0x7F ; 127 aa0: 80 e8 ldi r24, 0x80 ; 128 aa2: 70 e0 ldi r23, 0x00 ; 0 aa4: 60 e0 ldi r22, 0x00 ; 0 aa6: 08 95 ret Disassembly of section .text.avrlibc.fplib: 00000acc <__fp_nan>: acc: 9f ef ldi r25, 0xFF ; 255 ace: 80 ec ldi r24, 0xC0 ; 192 ad0: 08 95 ret Disassembly of section .text.avrlibc.fplib: 00000a72 <__fp_pscA>: a72: 00 24 eor r0, r0 a74: 0a 94 dec r0 a76: 16 16 cp r1, r22 a78: 17 06 cpc r1, r23 a7a: 18 06 cpc r1, r24 a7c: 09 06 cpc r0, r25 a7e: 08 95 ret Disassembly of section .text.avrlibc.fplib: 00000a80 <__fp_pscB>: a80: 00 24 eor r0, r0 a82: 0a 94 dec r0 a84: 12 16 cp r1, r18 a86: 13 06 cpc r1, r19 a88: 14 06 cpc r1, r20 a8a: 05 06 cpc r0, r21 a8c: 08 95 ret Disassembly of section .text.avrlibc.fplib: 000009ce <__fp_round>: 9ce: 09 2e mov r0, r25 9d0: 03 94 inc r0 9d2: 00 0c add r0, r0 9d4: 11 f4 brne .+4 ; 0x9da <__fp_round+0xc> 9d6: 88 23 and r24, r24 9d8: 52 f0 brmi .+20 ; 0x9ee <__fp_round+0x20> 9da: bb 0f add r27, r27 9dc: 40 f4 brcc .+16 ; 0x9ee <__fp_round+0x20> 9de: bf 2b or r27, r31 9e0: 11 f4 brne .+4 ; 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0x906 <__fp_splitA+0x30> 8f6: 16 16 cp r1, r22 8f8: 17 06 cpc r1, r23 8fa: 18 06 cpc r1, r24 8fc: 99 1f adc r25, r25 8fe: f1 cf rjmp .-30 ; 0x8e2 <__fp_splitA+0xc> 900: 86 95 lsr r24 902: 71 05 cpc r23, r1 904: 61 05 cpc r22, r1 906: 08 94 sec 908: 08 95 ret Disassembly of section .text.avrlibc.fplib: 00000a8e <__fp_zero>: a8e: e8 94 clt 00000a90 <__fp_szero>: a90: bb 27 eor r27, r27 a92: 66 27 eor r22, r22 a94: 77 27 eor r23, r23 a96: cb 01 movw r24, r22 a98: 97 f9 bld r25, 7 a9a: 08 95 ret Disassembly of section .text.avrlibc.fplib: 00000ac4 <__mulsf3>: ac4: 0e 94 7a 03 call 0x6f4 ; 0x6f4 <__mulsf3x> ac8: 0c 94 e7 04 jmp 0x9ce ; 0x9ce <__fp_round> Disassembly of section .text.avrlibc.fplib: 000006d6 <__mulsf3x-0x1e>: 6d6: 0e 94 39 05 call 0xa72 ; 0xa72 <__fp_pscA> 6da: 38 f0 brcs .+14 ; 0x6ea <__divsf3_pse+0xca> 6dc: 0e 94 40 05 call 0xa80 ; 0xa80 <__fp_pscB> 6e0: 20 f0 brcs .+8 ; 0x6ea <__divsf3_pse+0xca> 6e2: 95 23 and r25, r21 6e4: 11 f0 breq .+4 ; 0x6ea <__divsf3_pse+0xca> 6e6: 0c 94 4e 05 jmp 0xa9c ; 0xa9c <__fp_inf> 6ea: 0c 94 66 05 jmp 0xacc ; 0xacc <__fp_nan> 6ee: 11 24 eor r1, r1 6f0: 0c 94 48 05 jmp 0xa90 ; 0xa90 <__fp_szero> 000006f4 <__mulsf3x>: 6f4: 0e 94 63 04 call 0x8c6 ; 0x8c6 <__fp_split3> 6f8: 70 f3 brcs .-36 ; 0x6d6 <__divsf3_pse+0xb6> 000006fa <__mulsf3_pse>: 6fa: 95 9f mul r25, r21 6fc: c1 f3 breq .-16 ; 0x6ee <__divsf3_pse+0xce> 6fe: 95 0f add r25, r21 700: 50 e0 ldi r21, 0x00 ; 0 702: 55 1f adc r21, r21 704: 62 9f mul r22, r18 706: f0 01 movw r30, r0 708: 72 9f mul r23, r18 70a: bb 27 eor r27, r27 70c: f0 0d add r31, r0 70e: b1 1d adc r27, r1 710: 63 9f mul r22, r19 712: aa 27 eor r26, r26 714: f0 0d add r31, r0 716: b1 1d adc r27, r1 718: aa 1f adc r26, r26 71a: 64 9f mul r22, r20 71c: 66 27 eor r22, r22 71e: b0 0d add r27, r0 720: a1 1d adc r26, r1 722: 66 1f adc r22, r22 724: 82 9f mul r24, r18 726: 22 27 eor r18, r18 728: b0 0d add r27, r0 72a: a1 1d adc r26, r1 72c: 62 1f adc r22, r18 72e: 73 9f mul r23, r19 730: b0 0d add r27, r0 732: a1 1d adc r26, r1 734: 62 1f adc r22, r18 736: 83 9f mul r24, r19 738: a0 0d add r26, r0 73a: 61 1d adc r22, r1 73c: 22 1f adc r18, r18 73e: 74 9f mul r23, r20 740: 33 27 eor r19, r19 742: a0 0d add r26, r0 744: 61 1d adc r22, r1 746: 23 1f adc r18, r19 748: 84 9f mul r24, r20 74a: 60 0d add r22, r0 74c: 21 1d adc r18, r1 74e: 82 2f mov r24, r18 750: 76 2f mov r23, r22 752: 6a 2f mov r22, r26 754: 11 24 eor r1, r1 756: 9f 57 subi r25, 0x7F ; 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